嵌入式系統(tǒng)以太網(wǎng)卡控制器LAN91C96

摘要：以L(fǎng)AN91C96為例，介紹嵌入式以太網(wǎng)控制器基本結(jié)構(gòu)；結(jié)合PXA250(XScale)，分析嵌入式系統(tǒng)網(wǎng)絡(luò)接口卡（NIC）軟硬件設(shè)計(jì)。

引 言

　　當(dāng)今社會(huì)已經(jīng)進(jìn)入數(shù)字信息技術(shù)和網(wǎng)絡(luò)技術(shù)高速發(fā)展的后PC(Post-PC)時(shí)代，嵌入式系統(tǒng)已經(jīng)廣泛滲透到科學(xué)研究、工程設(shè)計(jì)、軍事技術(shù)、各類(lèi)產(chǎn)業(yè)和商業(yè)文化藝術(shù)、娛樂(lè)業(yè)以及人們的日常生活等方方面面；而網(wǎng)絡(luò)技術(shù)的快速發(fā)展和互聯(lián)網(wǎng)的廣泛應(yīng)用，使得嵌入式產(chǎn)品有了更廣泛的前景。各種家電設(shè)備、PDA、儀器儀表、工業(yè)生產(chǎn)中數(shù)據(jù)的采集與控制等設(shè)備正在逐漸走向網(wǎng)絡(luò)化，以共享互聯(lián)網(wǎng)絡(luò)中龐大的信息資源。嵌入式設(shè)備的網(wǎng)絡(luò)化開(kāi)發(fā)有著廣闊的前景。

　　本文以SMSC公司的LAN91C96嵌入式以太網(wǎng)控制器為例，介紹嵌入式系統(tǒng)網(wǎng)絡(luò)接口卡(NIC)的軟硬件設(shè)計(jì)。

1 以太網(wǎng)控制器LAN91C96簡(jiǎn)介

　　LAN91C96是SMSC公司生產(chǎn)的專(zhuān)門(mén)用于嵌入式產(chǎn)品的10M以太網(wǎng)控制器。其優(yōu)良的性能、低功耗及小尺寸，使LAN91C96成為嵌入式NIC中的主流產(chǎn)品。

圖1

1.1 主要特點(diǎn)

◆ 支持IEEE802.3(ANSI8802-3)以太網(wǎng)標(biāo)準(zhǔn)

◆ 全雙工收發(fā)方式，具有睡眠模式

◆ 6KB的片上RAM

◆ 與處理器接口可采用PCMCIA、ISA或Motorola 68000

◆ 支持先進(jìn)的傳輸隊(duì)列管理

◆ 硬件MMU

◆通過(guò)串行EEPROM選擇性配置

◆ 全雙工傳輸模式

◆可連接同軸電纜和雙絞線(xiàn)，支持10Base5、10Base2、10BaseT，并可自動(dòng)檢測(cè)所連介質(zhì)

◆ 高級(jí)的電源管理特性

◆ 支持“Magic Packet”電源管理技術(shù)

◆ 低功耗的CMOS設(shè)計(jì)

1.2 內(nèi)部框架

　　圖1是LAN91C96原理框圖。

　　LAN91C96網(wǎng)卡控制其內(nèi)部集成了6KB的RAM，用來(lái)存放數(shù)據(jù)包。內(nèi)部的MMU、判決器和DMA對(duì)數(shù)據(jù)包的傳輸發(fā)送進(jìn)行有效的管理。CSMA/CD(載波監(jiān)聽(tīng)多路訪(fǎng)問(wèn)/沖突避免)模塊集成了IEEE 802.3 MAC層協(xié)議，負(fù)責(zé)監(jiān)聽(tīng)網(wǎng)絡(luò)情況和地址過(guò)濾，若目的地址是LAN91C96的地址、廣播地址或多播地址，則接收此數(shù)據(jù)包，否則拋棄。內(nèi)部物理接口(PHY)包含一個(gè)ENDEC和10BaseT Transceiver。編解碼器(ENDEC)負(fù)責(zé)曼徹斯特(Manchester)編解碼，并提供標(biāo)準(zhǔn)6腳連接單元接口(AUI)，外接同軸傳輸接收器，應(yīng)用10Base2/5。傳輸數(shù)據(jù)時(shí)，10BaseT Transceiver負(fù)責(zé)把主控制器傳過(guò)來(lái)的反向不歸零碼(NRZ)數(shù)據(jù)轉(zhuǎn)換為Manchester數(shù)據(jù)，并以適當(dāng)?shù)碾娖郊右则?qū)動(dòng)；接收時(shí)負(fù)責(zé)連接完整性測(cè)試。外接的串行電可擦除只讀ROM(EEPROM)中可存儲(chǔ)網(wǎng)卡的MAC地址，當(dāng)OS啟動(dòng)加載網(wǎng)卡時(shí)，以太網(wǎng)控制器就從EEPROM的固定地址中讀取MAC地址并存儲(chǔ)在相應(yīng)的寄存器中。

1.3 工作原理

　　LAN91C96內(nèi)部6KB的RAM為數(shù)據(jù)包的傳輸接收提供緩沖，使全雙工工作模式下數(shù)據(jù)傳輸率可達(dá)10Mbps；MMU把RAM分成256B的頁(yè)，并負(fù)責(zé)為每個(gè)數(shù)據(jù)幀分配一個(gè)或多個(gè)頁(yè)。

　　當(dāng)主處理器傳輸數(shù)據(jù)時(shí)，MMU首先根據(jù)數(shù)據(jù)大小為其在RAM中分配若干頁(yè)。在數(shù)據(jù)傳送到RAM時(shí)，此數(shù)據(jù)幀的幀號(hào)也在TX FIFO中排隊(duì)，然后此數(shù)據(jù)幀在輪到時(shí)傳送到PHY模塊進(jìn)行Manchester編碼，最后根據(jù)CSMA/CD協(xié)議把此數(shù)據(jù)幀傳送到相應(yīng)的介質(zhì)上。

　　在介質(zhì)上有數(shù)據(jù)時(shí)，LAN91C96將數(shù)據(jù)幀復(fù)制一份并傳送到ENDEC模塊進(jìn)行Manchester解碼，而CSMA/CD模塊根據(jù)該數(shù)據(jù)幀頭的目的地址是否為本網(wǎng)卡MAC地址、廣播或多播地址來(lái)決定此數(shù)據(jù)幀的取舍。若地址匹配，MMU為其在RAM中開(kāi)辟相應(yīng)大小的空間，并以中斷的方式告知主處理器。在數(shù)據(jù)幀被取走后，MMU釋放此塊內(nèi)存。

1.4 數(shù)據(jù)幀的構(gòu)成

　　一個(gè)IEEE 802.3數(shù)據(jù)幀由以下幾個(gè)部分組成：前導(dǎo)位(preamle)、幀起始位(SFD)、目的地址(destination)、源地址(source)、數(shù)據(jù)長(zhǎng)度(length)、數(shù)據(jù)(data)、幀校驗(yàn)字(FCS)。如圖2所示，數(shù)據(jù)的數(shù)量范圍46~1500B，如一組要傳送的數(shù)據(jù)為46B，就用零補(bǔ)足；超過(guò)1500B時(shí)，需要拆成多個(gè)幀傳送。前導(dǎo)位、幀起始位和幀校驗(yàn)字僅供控制器本身用，主處理器收到的數(shù)據(jù)幀的組成依次包括：接收狀態(tài)(1B)、下一幀的頁(yè)地址指針(1B)、目的地址(6B)、源地址(6B)、數(shù)據(jù)長(zhǎng)度/幀類(lèi)型(2B)、數(shù)據(jù)。數(shù)據(jù)長(zhǎng)度/幀類(lèi)型的值小于或等于1500B時(shí)，表示數(shù)據(jù)場(chǎng)的長(zhǎng)度；反之，表示數(shù)據(jù)幀的類(lèi)型。如值依次為 0x08、0x00，表示數(shù)據(jù)為IP包；值依次為0x08、0x06，表示數(shù)據(jù)為ARP包。

2 以太網(wǎng)卡設(shè)計(jì)方案

2.1 硬件設(shè)計(jì)方案

　　此設(shè)計(jì)方案采用的嵌入式處理器是Intel公司的PXA250(XScale)。該處理器是Intel為了滿(mǎn)足便攜式和嵌入式應(yīng)用需求而優(yōu)化的微處理器。PXA250基于Intel XScale微體系結(jié)構(gòu)，RISC架構(gòu)，最高可以運(yùn)行400MHz。 PXA250采用ARM指令、數(shù)據(jù)高速緩存、內(nèi)存管理單元(MMU)和讀/寫(xiě)緩沖器。另外，PXA250提供系統(tǒng)支持邏輯、多串行通信通道、彩色/灰度刻度LCD控制器、支持PCMCIA、通用I/O端口、USB、串口、紅外接口、JTAG、音頻等。

　　圖3是嵌入式以太網(wǎng)卡的原理圖。LANC91C96內(nèi)部寄存器可通過(guò)對(duì)地址線(xiàn)A0、A1、A2、A3……的操作來(lái)訪(fǎng)問(wèn)，LAN91C96內(nèi)部寄存器寬度是16bit；而PXA250的訪(fǎng)問(wèn)寬度是32bit，所以L(fǎng)ANC91C96的A1、A2、A3……分別與P

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